數字邏輯（第六版 立體化教材 ） pdf epub mobi txt 電子書 下載 2025

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硃正東，方維，吳俊 著，白中英，謝鬆雲 編

齣版社： 科學齣版社

ISBN：9787030369093

版次：6

商品編碼：12022458

包裝：平裝

叢書名： "十二五"普通高等教育本科國傢級規劃教材

開本：16開

齣版時間：2013-03-01

用紙：膠版紙

頁數：206

字數：304000

正文語種：中文

附件：光盤

附件數量：1

內容簡介

　　《數字邏輯（第六版 立體化教材）》為“十二五”普通高等教育本科國傢級規劃教材。全書內容共分8章：第0章成纔之路，第1章開關理論基礎，第2章組閤邏輯，第3章時序邏輯，第4章存儲邏輯，第5章可編程邏輯，第6章數字係統，第7章A/D轉換、D/A轉換。教學內容具有基礎性和時代性，從理論與實踐兩方麵解決瞭與後續課程的銜接。
　　《數字邏輯（第六版 立體化教材）》是作者對“數字邏輯”課程體係、教學內容、教學方法和教學手段進行綜閤改革的具體成果。《數字邏輯（第六版 立體化教材）》內容全麵，取材新穎，概念清楚，係統性強，注重實踐教學和能力培養，形成瞭文字主副教材、多媒體CAI課件、試題庫、習題庫、實驗儀器、教學實驗、課程設計等綜閤配套的立體化教學體係。
　　全書文字流暢，通俗易懂，有廣泛的適應麵，可作為高等院校計算機、電子、通信、自動控製等信息類專業的技術基礎課教材，也可作為成人自學考試用書。

作者簡介

　　白中英，北京郵電大學計算機學院二級教授，博士生導師。研究方嚮：計算機體係結構。網絡安全。在工程和科學研究中，先後主持完成國傢863項目、國傢自然科學基金項露4項，省部級項目6項。1項成果獲全國科學大會重大成果奬，1項成果獲國傢科技進步奬，5項成果獲部級科技進步一、二等奬，3項成果獲國傢發明專利。在教育和教學研究中，《計算機組成原理教程》獲國傢優秀教材特等奬，4項成果獲國傢教學成果奬。2003年首屆北京市“教學名師奬”，2008年“國傢優秀教學團隊”。齣版著作15部，發錶學術論文60餘篇。指導博士、碩士研究生50餘人。
　　
　　謝鬆雲，博士學位，德國柏林工業大學博士後。西北工業大學電子信息學院教授、博士生導師。主要從事電子科學與技術、信號與信息處理、模式識彆等方麵的教學與科研工作。在教學研究中，作為模擬電子和數字電子技術2門課程負責人，主持“模擬電子技術”、“數字電子技術”2門陝西省精品課程等教改項目，2010年國傢優秀教學團隊主要成員。齣版中英文教材11本。在科學研究中，主持和參加國傢自然科學基金，國傢863等科研項目20餘項。獲得軟件著作權2項、發錶中英文學術論文40餘篇、其中三大檢索15篇。獲陝西省科學技術進步奬、西安市科學技術進步奬2項。

目錄

第0章成纔之路
0．1 立誌·奮鬥·機遇
0．2 知識·智力·能力
0．3 業績定律公式
0．4 實驗教學的定位和組織
0．5 創新與實踐

第1章 開關理論基礎
1．1 二進製係統
1．1．1 連續量和離散量
1．1．2 開關量
1．1．3 數字波形
1．2 數製與碼製
1．2．1 進位計數製
1．2．2 進位計數製的相互轉換
1．2．3 二進製編碼
1．3 邏輯函數及其描述工具
1．3．1 邏輯函數的基本概念
1．3．2 邏輯函數的描述工具
1．3．3 基本邏輯運算
1．3．4 正邏輯、負邏輯、三態門
1．4 布爾代數
1．4．1 布爾代數的基本定律
1．4．2 布爾代數運算的基本規則
1．4．3 用布爾代數簡化邏輯函數
1．5 卡諾圖
1．5．1 卡諾圖的結構與特點
1．5 2用卡諾圖簡化邏輯函數
1．6 數字集成電路
1．6．1 集成電路的製造技術類型
1．6．2 集成電路的封裝類型
1．6．3 集成電路的規模類型
1．6．4 集成電路的使用特性
小結
習題

第2章 組閤邏輯
2．1 組閤邏輯分析
2．1．1 逐級電平推導法
2．1．2 列寫布爾錶達式法
2．1．3 數字波形圖分析法
2．1．4 列寫邏輯電路真值錶法
2．1．5 組閤邏輯中的競爭冒險
2．2 組閤邏輯設計
2．2．1 組閤邏輯設計步驟
2．2．2 邏輯問題的描述
2．2．3 利用任意項的邏輯設計
2．3 組閤邏輯電路的等價變換
2．3．1 狄摩根定理的應用
2．3．2 與非門、或非門作為通用元件
2．3．3 利用與非門／非或門進行等價變換
2．3．4 邏輯函數的“與或非”門實現
2．4 數據選擇器與分配器
2．4．1 數據選擇器
2．4．2 數據分配器
2．5 譯碼器和編碼器
2．5．1 譯碼器
2．5．2 編碼器
2．6 數據比較器和加法器
2．6．1 數據比較器
2．6．2 加法器
2．7 奇偶校驗器
2．7．1 奇偶校驗的基本原理
2．7．2 具有奇偶校驗的數據傳輸
小結
習題

第3章 時序邏輯
3．1 鎖存器
3．1．1 鎖存器的基本特性
3．1．2 基本SR鎖存器
3．1．3 門控SR鎖存器
3．1．4 門控D鎖存器
3．2 觸發器
3．2．1 SR觸發器
3．2．2 D觸發器
3．2．3 JK觸發器
3．2．4 觸發器的應用和時間參數
3．3 寄存器和移位寄存器
3．3．1 寄存器
3．3．2 移位寄存器
3．4 計數器
3．4．1 同步計數器
3．4．2 異步計數器
3．4．3 中規模集成計數器及應用
3．5 定時脈衝産生器
3．5．1 時鍾脈衝源電路
3．5．2 節拍脈衝産生器
3．5．3 數字鍾
3．6 同步時序邏輯分析
3．6．1 同步時序邏輯電路的描述工具
3．6．2 同步時序邏輯電路分析的一般方法
3．7 同步時序邏輯設計
3．7．1 同步時序邏輯設計方法和步驟
3．7．2 建立原始狀態錶的方法
3．7．3 狀態編碼
小結
習題

第4章 存儲邏輯
4．1 特殊存儲部件
4．1．1 寄存器堆
4．1．2 寄存器隊列
4．1．3 寄存器堆棧
4．2 隨機讀寫存儲器RAM
4．2．1 RAM的邏輯結構
4．2．2 地址譯碼方法
4．2．3 SRAM存儲器
4．2．4 DRAM存儲器
4．3 隻讀存儲器ROM
4．3．1 掩模ROM
4．3．2 可編程ROM
4．4 FLAsH存儲器
4．4．1 FLASH存儲元
4．4．2 FLASH存儲器的基本操作
4．4．3 FLASH存儲器的陣列結構
4．5 存儲器容量的擴充
4．5．1 字長位數擴展
4．5．2 字存儲容量擴展
小結
習題

第5章 可編程邏輯
5．1 PLD的基本概念
5．1．1 可編程陣列
5．1．2 PLD的類型
5．2 現場可編程門陣列FPGA
5．2．1 FPGA的基本結構
5．2．2 可組態邏輯塊CLB
5．2．3 SRAM為基礎的FPGA
5．3 在係統可編程ISP
5．3．1 ispLSI器件的體係結構
5．3．2 EPM7128S器件的體係結構
5．3．3 在係統編程原理
5．4 可編程邏輯的原理圖方式設計
5．4．1 編程環境和設計流程圖
5．4．2 設計輸入
5．4．3 功能模擬
5．4．4 綜閤和實現（軟件）
5．4．5 時序模擬
5．4．6 器件下載
5．5 可編程邏輯的VHDL文本方式設計
5．5．1 VHDL的基本概念
5．5．2 VHDL的組閤邏輯設計
5．5．3 VHDL的時序邏輯設計
小結
習題

第6章 數字係統
6．1 數字係統的基本概念
6．1．1 一個數字係統實例
6．1．2 數字係統的基本模型
6．1．3 數字係統與邏輯功能部件的區彆
6．2 數據通路
6．2．1 總綫結構
6．2．2 數據通路實例
6．3 由頂嚮下的設計方法
6．3．1 數字係統的設計任務
6．3．2 算法狀態機和算法流程圖
6．4 小型控製器的設計
6．4．1 控製器的基本概念
6．4．2 計數器型控製器
6．4．3 多路選擇器型控製器
6．4．4 定序型控製器
6．5 數字係統設計實例
6．5．1 由頂嚮下——子係統的劃分
6．5．2 小型控製器的實現方案
小結
習題

第7章 A／D轉換、D／A轉換
7．1 數字信號處理的基本概念
7．2 A／D轉換
7．2．1 采樣定理
7．2．2 模數轉換過程
7．2．3 A／D轉換器
7．2．4 ADC的性能參數
7．3 D／A轉換
7．3．1 權電阻DAc
7．3．2 R2R T型DAC
7．3．3 R2R倒T型DAc
7．3．4 DAC的性能參數
小結
習題
參考文獻
附錄《數字邏輯》（第六版立體化教材）配套教材與教學設備

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