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內容介紹

基本信息

書名:EDA技術與實踐教程(含光盤1張)

原價：26.00元

作者:宋烈武 編著

齣版社：電子工業齣版社

齣版日期：2009-8-1

ISBN：9787121091018

字數：340000

頁碼：199

版次：1

裝幀：平裝

開本：16開

商品重量：

編輯推薦

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任務驅動，行動導嚮，工學結閤，學生主體，過程考核。

內容提要

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本書提供瞭參考授課計劃及自學建議；第1章概述瞭EDA技術的主要內容；第2章簡要介紹瞭FPGA/CPLD的結構與工作原理及其配置與編程方法；第3章介紹瞭Quartus Ⅱ設計流程及6個設計實例；第4章介紹瞭硬件描述語言VHDL語法概要；第5章用VHDL給齣瞭常用單元電路的設計；第6章由淺入深精選瞭6個基礎訓練項目；第7章精選瞭6個綜閤訓練項目。本教材提供的所有VHDL代碼均在Altera推廣型開發工具Quartus Ⅱ 9.0 SP1上綜閤通過，部分例題給齣瞭仿真結果，另附Quartus Ⅱ開發工具及相關資料DVD光盤一張。
本書可作為各高職院校電子類、通信類及計算機類等相關專業二年級及以上學生的教材，也可作為電子技術工程技術人員的參考用書。

目錄

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第一篇 EDA技術基礎
第1章 概述
1.1 EDA技術的含義
1.2 EDA技術的主要內容
1.3 EDA技術的特點及發展趨勢
第2章 可編程邏輯器件
2.1 概述
2.2 大規模可編程邏輯器件
2.3 Altera新型係列器件簡介
2.4 FPGA/CPLD器件的配置與編程
第3章 QuartusⅡ設計基礎
3.1 概述
3.2 QuartusⅡ的安裝與授權
3.3 QuartusⅡ設計流程
3.4 QuartusⅡ設計實例
第4章 硬件描述語言VHDL語法概要
4.1 概述
4.2 VHDL程序基本結構
4.3 VHDL語言要素
4.4 VHDL的基本描述語句
4.5 子程序、程序包和配置
第5章 常用模塊電路的VHDL設計
5.1 常用組閤邏輯電路的設計
5.2 時序邏輯電路的設計
5.3 狀態機的設計
5.4 存儲器的設計
第二篇 實戰訓練
第6章 基礎訓練
6.1 一位全加器原理圖輸入設計
6.2 譯碼顯示電路的設計
6.3 含異步清零和同步時鍾使能的４位加法計數器的設計
6.4 數控分頻器的設計
6.5 用狀態機實現序列檢測器的設計
6.6 簡易正弦信號發送器的設計
第7章 綜閤訓練
7.1 鍵盤輸入電路的設計
7.2 動態輸齣4位十進製頻率計的設計
7.3 數字鍾的設計
7.4 DDS信號源的設計
7.5 基於Dsp Builder使用IP Core的FIR濾波器的設計
7.6 基於NiosⅡ的SD卡音樂播放器的實現
附錄
A.DE2基本資料
B.基於MAXⅡ EPM240芯片的WZ型最小係統實驗闆基本資料
C.FPGA/CPLD主要廠商及開發工具簡介
參考文獻

作者介紹

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文摘

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序言

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關聯推薦
本書可作為高職院校電子類、通信類及計算機類等相關專業的教材，也可作為電子技術工程人員的參考用書
目錄
第一篇 EDA技術基礎
第1章 概述
1.1 EDA技術的含義
1.2 EDA技術的主要內容
1.3 EDA技術的特點及發展趨勢
第2章 可編程邏輯器件
2.1 概述
2.1.1 可編程邏輯器件的發展曆程
2.1.2 簡單可編程邏輯器件的基本結構
2.1.3 可編程邏輯器件的主要分類
2.2 大規模可編程邏輯器件
2.2.1 FPGA的結構與工作原理
2.2.2 CPLD的結構與工作原理
2.2.3 其他類型的FPGA和CPLD
2.2.4 Altera成熟器件及命名規則
2.2.5 FPGA和CPLD的開發應用選擇
2.2.6 Altera配置芯片簡介
2.3 Altera新型係列器件簡介
2.3.1 Stratix係列高端FPGA簡介
2.3.2 Arria係列中端FPGA簡介
2.3.3 Cyclone係列低端FPGA簡介
2.3.4 MAX Ⅱ係列低成本CPLD簡介
2.3.5 HardCopy ASIC係列簡介
2.4 FPGA/CPLD器件的配置與編程
2.4.1 下載電纜
2.4.2 配置與編程模式
2.4.3 配置方式
第3章 QuartusⅡ設計基礎
3.1 概述
3.2 QuartusⅡ的安裝與授權
3.3 QuartusⅡ設計流程
3.4 QuartusⅡ設計實例
3.4.1 輸入設計與編譯
3.4.2 仿真及時序分析
3.4.3 下載實現及硬件測試
3.4.4 可參數化宏模塊的調用
3.4.5 Dsp Builder的應用
3.4.6 設計一個簡單的CPU係統
第4章 硬件描述語言VHDL語法概要
4.1 概述
4.1.1 VHDL的特點
4.1.2 學習VHDL的注意事項
4.2 VHDL程序基本結構
4.2.1 庫
4.2.2 實體
4.2.3 結構體
4.3 VHDL語言要素
4.3.1 文字規則
4.3.2 數據對象
4.3.3 數據類型
4.3.4 類型轉換
4.3.5 運算操作符
4.3.6 屬性
4.4 VHDL的基本描述語句
4.4.1 順序語句
4.4.2 並行語句
4.4.3 其他語句
4.5 子程序、程序包和配置
4.5.1 子程序
4.5.2 程序包
4.5.3 配置
第5章 常用模塊電路的VHDL設計
5.1 常用組閤邏輯電路的設計
5.1.1 七段譯碼器
5.1.2 優先編碼器
5.1.3 多路選擇器
5.1.4 求補器
5.1.5 三態門及總綫緩衝器
5.2 時序邏輯電路的設計
5.2.1 觸發器的設計
5.2.2 移位寄存器的設計
5.2.3 計數器的設計
5.3 狀態機的設計
5.3.1 摩爾狀態機的設計
5.3.2 米裏狀態機的設計
5.4 存儲器的設計
5.4.1 隻讀存儲器的設計
5.4.2 隨機存儲器的設計
5.4.3 堆棧的設計
第二篇 實戰訓練
第6章 基礎訓練
6.1 一位全加器原理圖輸入設計
6.2 譯碼顯示電路的設計
6.3 含異步清零和同步時鍾使能的４位加法計數器的設計
6.4 數控分頻器的設計
6.5 用狀態機實現序列檢測器的設計
6.6 簡易正弦信號發送器的設計
第7章 綜閤訓練
7.1 鍵盤輸入電路的設計
7.2 動態輸齣4位十進製頻率計的設計
7.3 數字鍾的設計
7.4 DDS信號源的設計
7.5 基於Dsp Builder使用IP Core的FIR濾波器的設計
7.6 基於NiosⅡ的SD卡音樂播放器的實現
附錄
A．DE2基本資料
B．基於MAXⅡ EPM240芯片的WZ型最小係統實驗闆基本資料
C．FPGA/CPLD主要廠商及開發工具簡介
參考文獻

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