需要1,400,000 UI 来申明TX PLL锁定
评分1. WAIT_FOR_PLOL: 等待直到TX PLL锁定并且接收数据出现。rx_serdes_rst_ch[3:0]_c 设为0,因为当
评分rx_cdr_lol_ch[3:0]_s 状态信号是CDR锁定状态指示符,如上定义。然而,在 CDR锁定过程中,当没有输入数据出
评分3. WAIT_FOR_TIMER1: 等待至少3 ns 。
评分tx_pll_lol_qd_s: : 1 = TX PLL 失锁
评分上电和配置后,进行所有SERDES复位和FPGA 复位。
评分需要1,400,000 UI 来申明TX PLL锁定
评分5. NORMAL: 释放tx_pcs_rst_ch#_c 。正常工作情况下,如果tx_pll_lol_qd_s 变为高电平,转到
评分复位序列和复位状态图
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